{"id":11802,"date":"2026-08-31T15:07:40","date_gmt":"2026-08-31T18:07:40","guid":{"rendered":"https:\/\/www.icex.ufmg.br\/icex_novo\/?p=11802"},"modified":"2026-08-31T15:19:46","modified_gmt":"2026-08-31T18:19:46","slug":"palestra-seguranca-em-sistemas-manycores-baseados-em-noc","status":"publish","type":"post","link":"https:\/\/www.icex.ufmg.br\/icex_novo\/palestra-seguranca-em-sistemas-manycores-baseados-em-noc\/","title":{"rendered":"Palestra: Seguran\u00e7a em sistemas manycores baseados em NoC"},"content":{"rendered":"\t\t
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O professor do Departamento de Ci\u00eancia da Computa\u00e7\u00e3o (DCC) da UFMG, Rafael Follmann Faccenda, ir\u00e1 proferir, na pr\u00f3xima sexta-feira, 04, \u00e0s 10 horas, na sala 2077 do ICEx, como parte dos Semin\u00e1rios Avan\u00e7ados da P\u00f3s-gradua\u00e7\u00e3o, a palestra \u201cSeguran\u00e7a em sistemas manycores baseados em NoC\u201d. O evento \u00e9 gratuito e aberto ao p\u00fablico, n\u00e3o havendo necessidade de inscri\u00e7\u00e3o pr\u00e9via.<\/p>

Resumo: \u201cSistemas manycore em chip (ou apenas manycores) alcan\u00e7am alto desempenho atrav\u00e9s de paralelismo. Estes sistemas cont\u00e9m Elementos de Processamento (PEs) interconectados por infraestruturas de comunica\u00e7\u00e3o como Redes-em-Chip (NoCs). Na medida que os SoCs se tornam amplamente adotados e sua complexidade aumenta, tamb\u00e9m surgem mais vulnerabilidades e a prote\u00e7\u00e3o de dados emerge como um requisito cr\u00edtico de projeto. A quest\u00e3o central de pesquisa \u00e9: como proteger aplica\u00e7\u00f5es executando em manycores contra amea\u00e7as de seguran\u00e7a em hardware?\u201d<\/p>

Bio: Doutor em Ci\u00eancia da Computa\u00e7\u00e3o pela PUCRS (2024), mestre em Ci\u00eancia da Computa\u00e7\u00e3o (2020) e Engenheiro de Computa\u00e7\u00e3o (2018) pela UFSM. Atua na pesquisa de sistemas manycore baseados em redes intra-chip (NoC), com foco em seguran\u00e7a de hardware. Realizou est\u00e1gio p\u00f3s-doutoral na PUCRS, onde participou do desenvolvimento do bloco digital de um SoC para monitoramento de sinais vitais, que integra um processador RISC-V, atuando desde a especifica\u00e7\u00e3o at\u00e9 a fabrica\u00e7\u00e3o do circuito integrado.

Por Nathalie Raj\u00e3o<\/span><\/a><\/span>
https:\/\/dcc.ufmg.br\/palestra-seguranca-em-sistemas-manycores-baseados-em-noc\/<\/a><\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t<\/div>\n\t\t","protected":false},"excerpt":{"rendered":"

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